//===- TableGen'erated file -------------------------------------*- C++ -*-===//
//
// Register Information Source Fragment
//
// Automatically generated file, do not edit!
//
//===----------------------------------------------------------------------===//
namespace llvm {
namespace { // Register classes...
// CARRYRC Register Class...
static const unsigned CARRYRC[] = {
PPC::CARRY,
};
// CRBITRC Register Class...
static const unsigned CRBITRC[] = {
PPC::CR0LT, PPC::CR0GT, PPC::CR0EQ, PPC::CR0UN, PPC::CR1LT, PPC::CR1GT, PPC::CR1EQ, PPC::CR1UN, PPC::CR2LT, PPC::CR2GT, PPC::CR2EQ, PPC::CR2UN, PPC::CR3LT, PPC::CR3GT, PPC::CR3EQ, PPC::CR3UN, PPC::CR4LT, PPC::CR4GT, PPC::CR4EQ, PPC::CR4UN, PPC::CR5LT, PPC::CR5GT, PPC::CR5EQ, PPC::CR5UN, PPC::CR6LT, PPC::CR6GT, PPC::CR6EQ, PPC::CR6UN, PPC::CR7LT, PPC::CR7GT, PPC::CR7EQ, PPC::CR7UN,
};
// CRRC Register Class...
static const unsigned CRRC[] = {
PPC::CR0, PPC::CR1, PPC::CR5, PPC::CR6, PPC::CR7, PPC::CR2, PPC::CR3, PPC::CR4,
};
// CTRRC Register Class...
static const unsigned CTRRC[] = {
PPC::CTR,
};
// CTRRC8 Register Class...
static const unsigned CTRRC8[] = {
PPC::CTR8,
};
// F4RC Register Class...
static const unsigned F4RC[] = {
PPC::F0, PPC::F1, PPC::F2, PPC::F3, PPC::F4, PPC::F5, PPC::F6, PPC::F7, PPC::F8, PPC::F9, PPC::F10, PPC::F11, PPC::F12, PPC::F13, PPC::F31, PPC::F30, PPC::F29, PPC::F28, PPC::F27, PPC::F26, PPC::F25, PPC::F24, PPC::F23, PPC::F22, PPC::F21, PPC::F20, PPC::F19, PPC::F18, PPC::F17, PPC::F16, PPC::F15, PPC::F14,
};
// F8RC Register Class...
static const unsigned F8RC[] = {
PPC::F0, PPC::F1, PPC::F2, PPC::F3, PPC::F4, PPC::F5, PPC::F6, PPC::F7, PPC::F8, PPC::F9, PPC::F10, PPC::F11, PPC::F12, PPC::F13, PPC::F31, PPC::F30, PPC::F29, PPC::F28, PPC::F27, PPC::F26, PPC::F25, PPC::F24, PPC::F23, PPC::F22, PPC::F21, PPC::F20, PPC::F19, PPC::F18, PPC::F17, PPC::F16, PPC::F15, PPC::F14,
};
// G8RC Register Class...
static const unsigned G8RC[] = {
PPC::X2, PPC::X3, PPC::X4, PPC::X5, PPC::X6, PPC::X7, PPC::X8, PPC::X9, PPC::X10, PPC::X11, PPC::X12, PPC::X30, PPC::X29, PPC::X28, PPC::X27, PPC::X26, PPC::X25, PPC::X24, PPC::X23, PPC::X22, PPC::X21, PPC::X20, PPC::X19, PPC::X18, PPC::X17, PPC::X16, PPC::X15, PPC::X14, PPC::X31, PPC::X13, PPC::X0, PPC::X1, PPC::LR8,
};
// GPRC Register Class...
static const unsigned GPRC[] = {
PPC::R2, PPC::R3, PPC::R4, PPC::R5, PPC::R6, PPC::R7, PPC::R8, PPC::R9, PPC::R10, PPC::R11, PPC::R12, PPC::R30, PPC::R29, PPC::R28, PPC::R27, PPC::R26, PPC::R25, PPC::R24, PPC::R23, PPC::R22, PPC::R21, PPC::R20, PPC::R19, PPC::R18, PPC::R17, PPC::R16, PPC::R15, PPC::R14, PPC::R13, PPC::R31, PPC::R0, PPC::R1, PPC::LR,
};
// VRRC Register Class...
static const unsigned VRRC[] = {
PPC::V2, PPC::V3, PPC::V4, PPC::V5, PPC::V0, PPC::V1, PPC::V6, PPC::V7, PPC::V8, PPC::V9, PPC::V10, PPC::V11, PPC::V12, PPC::V13, PPC::V14, PPC::V15, PPC::V16, PPC::V17, PPC::V18, PPC::V19, PPC::V31, PPC::V30, PPC::V29, PPC::V28, PPC::V27, PPC::V26, PPC::V25, PPC::V24, PPC::V23, PPC::V22, PPC::V21, PPC::V20,
};
// VRSAVERC Register Class...
static const unsigned VRSAVERC[] = {
PPC::VRSAVE,
};
// CARRYRCVTs Register Class Value Types...
static const EVT CARRYRCVTs[] = {
MVT::i32, MVT::Other
};
// CRBITRCVTs Register Class Value Types...
static const EVT CRBITRCVTs[] = {
MVT::i32, MVT::Other
};
// CRRCVTs Register Class Value Types...
static const EVT CRRCVTs[] = {
MVT::i32, MVT::Other
};
// CTRRCVTs Register Class Value Types...
static const EVT CTRRCVTs[] = {
MVT::i32, MVT::Other
};
// CTRRC8VTs Register Class Value Types...
static const EVT CTRRC8VTs[] = {
MVT::i64, MVT::Other
};
// F4RCVTs Register Class Value Types...
static const EVT F4RCVTs[] = {
MVT::f32, MVT::Other
};
// F8RCVTs Register Class Value Types...
static const EVT F8RCVTs[] = {
MVT::f64, MVT::Other
};
// G8RCVTs Register Class Value Types...
static const EVT G8RCVTs[] = {
MVT::i64, MVT::Other
};
// GPRCVTs Register Class Value Types...
static const EVT GPRCVTs[] = {
MVT::i32, MVT::Other
};
// VRRCVTs Register Class Value Types...
static const EVT VRRCVTs[] = {
MVT::v16i8, MVT::v8i16, MVT::v4i32, MVT::v4f32, MVT::Other
};
// VRSAVERCVTs Register Class Value Types...
static const EVT VRSAVERCVTs[] = {
MVT::i32, MVT::Other
};
} // end anonymous namespace
namespace PPC { // Register class instances
CARRYRCClass CARRYRCRegClass;
CRBITRCClass CRBITRCRegClass;
CRRCClass CRRCRegClass;
CTRRCClass CTRRCRegClass;
CTRRC8Class CTRRC8RegClass;
F4RCClass F4RCRegClass;
F8RCClass F8RCRegClass;
G8RCClass G8RCRegClass;
GPRCClass GPRCRegClass;
VRRCClass VRRCRegClass;
VRSAVERCClass VRSAVERCRegClass;
// CARRYRC Sub-register Classes...
static const TargetRegisterClass* const CARRYRCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// CRBITRC Sub-register Classes...
static const TargetRegisterClass* const CRBITRCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// CRRC Sub-register Classes...
static const TargetRegisterClass* const CRRCSubRegClasses[] = {
0, &PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass
};
// CTRRC Sub-register Classes...
static const TargetRegisterClass* const CTRRCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// CTRRC8 Sub-register Classes...
static const TargetRegisterClass* const CTRRC8SubRegClasses[] = {
0, 0, 0, 0, 0
};
// F4RC Sub-register Classes...
static const TargetRegisterClass* const F4RCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// F8RC Sub-register Classes...
static const TargetRegisterClass* const F8RCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// G8RC Sub-register Classes...
static const TargetRegisterClass* const G8RCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// GPRC Sub-register Classes...
static const TargetRegisterClass* const GPRCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// VRRC Sub-register Classes...
static const TargetRegisterClass* const VRRCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// VRSAVERC Sub-register Classes...
static const TargetRegisterClass* const VRSAVERCSubRegClasses[] = {
0, 0, 0, 0, 0
};
// CARRYRC Super-register Classes...
static const TargetRegisterClass* const CARRYRCSuperRegClasses[] = {
NULL
};
// CRBITRC Super-register Classes...
static const TargetRegisterClass* const CRBITRCSuperRegClasses[] = {
&PPC::CRRCRegClass, NULL
};
// CRRC Super-register Classes...
static const TargetRegisterClass* const CRRCSuperRegClasses[] = {
NULL
};
// CTRRC Super-register Classes...
static const TargetRegisterClass* const CTRRCSuperRegClasses[] = {
NULL
};
// CTRRC8 Super-register Classes...
static const TargetRegisterClass* const CTRRC8SuperRegClasses[] = {
NULL
};
// F4RC Super-register Classes...
static const TargetRegisterClass* const F4RCSuperRegClasses[] = {
NULL
};
// F8RC Super-register Classes...
static const TargetRegisterClass* const F8RCSuperRegClasses[] = {
NULL
};
// G8RC Super-register Classes...
static const TargetRegisterClass* const G8RCSuperRegClasses[] = {
NULL
};
// GPRC Super-register Classes...
static const TargetRegisterClass* const GPRCSuperRegClasses[] = {
NULL
};
// VRRC Super-register Classes...
static const TargetRegisterClass* const VRRCSuperRegClasses[] = {
NULL
};
// VRSAVERC Super-register Classes...
static const TargetRegisterClass* const VRSAVERCSuperRegClasses[] = {
NULL
};
// CARRYRC Register Class sub-classes...
static const TargetRegisterClass* const CARRYRCSubclasses[] = {
NULL
};
// CRBITRC Register Class sub-classes...
static const TargetRegisterClass* const CRBITRCSubclasses[] = {
NULL
};
// CRRC Register Class sub-classes...
static const TargetRegisterClass* const CRRCSubclasses[] = {
NULL
};
// CTRRC Register Class sub-classes...
static const TargetRegisterClass* const CTRRCSubclasses[] = {
NULL
};
// CTRRC8 Register Class sub-classes...
static const TargetRegisterClass* const CTRRC8Subclasses[] = {
NULL
};
// F4RC Register Class sub-classes...
static const TargetRegisterClass* const F4RCSubclasses[] = {
&PPC::F8RCRegClass, NULL
};
// F8RC Register Class sub-classes...
static const TargetRegisterClass* const F8RCSubclasses[] = {
NULL
};
// G8RC Register Class sub-classes...
static const TargetRegisterClass* const G8RCSubclasses[] = {
NULL
};
// GPRC Register Class sub-classes...
static const TargetRegisterClass* const GPRCSubclasses[] = {
NULL
};
// VRRC Register Class sub-classes...
static const TargetRegisterClass* const VRRCSubclasses[] = {
NULL
};
// VRSAVERC Register Class sub-classes...
static const TargetRegisterClass* const VRSAVERCSubclasses[] = {
NULL
};
// CARRYRC Register Class super-classes...
static const TargetRegisterClass* const CARRYRCSuperclasses[] = {
NULL
};
// CRBITRC Register Class super-classes...
static const TargetRegisterClass* const CRBITRCSuperclasses[] = {
NULL
};
// CRRC Register Class super-classes...
static const TargetRegisterClass* const CRRCSuperclasses[] = {
NULL
};
// CTRRC Register Class super-classes...
static const TargetRegisterClass* const CTRRCSuperclasses[] = {
NULL
};
// CTRRC8 Register Class super-classes...
static const TargetRegisterClass* const CTRRC8Superclasses[] = {
NULL
};
// F4RC Register Class super-classes...
static const TargetRegisterClass* const F4RCSuperclasses[] = {
NULL
};
// F8RC Register Class super-classes...
static const TargetRegisterClass* const F8RCSuperclasses[] = {
&PPC::F4RCRegClass, NULL
};
// G8RC Register Class super-classes...
static const TargetRegisterClass* const G8RCSuperclasses[] = {
NULL
};
// GPRC Register Class super-classes...
static const TargetRegisterClass* const GPRCSuperclasses[] = {
NULL
};
// VRRC Register Class super-classes...
static const TargetRegisterClass* const VRRCSuperclasses[] = {
NULL
};
// VRSAVERC Register Class super-classes...
static const TargetRegisterClass* const VRSAVERCSuperclasses[] = {
NULL
};
CARRYRCClass::CARRYRCClass() : TargetRegisterClass(CARRYRCRegClassID, "CARRYRC", CARRYRCVTs, CARRYRCSubclasses, CARRYRCSuperclasses, CARRYRCSubRegClasses, CARRYRCSuperRegClasses, 4, 4, -1, CARRYRC, CARRYRC + 1) {}
CRBITRCClass::CRBITRCClass() : TargetRegisterClass(CRBITRCRegClassID, "CRBITRC", CRBITRCVTs, CRBITRCSubclasses, CRBITRCSuperclasses, CRBITRCSubRegClasses, CRBITRCSuperRegClasses, 4, 4, -1, CRBITRC, CRBITRC + 32) {}
CRRCClass::CRRCClass() : TargetRegisterClass(CRRCRegClassID, "CRRC", CRRCVTs, CRRCSubclasses, CRRCSuperclasses, CRRCSubRegClasses, CRRCSuperRegClasses, 4, 4, 1, CRRC, CRRC + 8) {}
CTRRCClass::CTRRCClass() : TargetRegisterClass(CTRRCRegClassID, "CTRRC", CTRRCVTs, CTRRCSubclasses, CTRRCSuperclasses, CTRRCSubRegClasses, CTRRCSuperRegClasses, 4, 4, 1, CTRRC, CTRRC + 1) {}
CTRRC8Class::CTRRC8Class() : TargetRegisterClass(CTRRC8RegClassID, "CTRRC8", CTRRC8VTs, CTRRC8Subclasses, CTRRC8Superclasses, CTRRC8SubRegClasses, CTRRC8SuperRegClasses, 8, 8, 1, CTRRC8, CTRRC8 + 1) {}
F4RCClass::F4RCClass() : TargetRegisterClass(F4RCRegClassID, "F4RC", F4RCVTs, F4RCSubclasses, F4RCSuperclasses, F4RCSubRegClasses, F4RCSuperRegClasses, 4, 4, 1, F4RC, F4RC + 32) {}
F8RCClass::F8RCClass() : TargetRegisterClass(F8RCRegClassID, "F8RC", F8RCVTs, F8RCSubclasses, F8RCSuperclasses, F8RCSubRegClasses, F8RCSuperRegClasses, 8, 8, 1, F8RC, F8RC + 32) {}
G8RCClass::iterator
G8RCClass::allocation_order_begin(const MachineFunction &MF) const {
// 64-bit SVR4 ABI: r2 is reserved for the TOC pointer.
// Darwin: r2 is reserved for CR save/restore sequence.
return begin()+1;
}
G8RCClass::iterator
G8RCClass::allocation_order_end(const MachineFunction &MF) const {
if (needsFP(MF))
return end()-5;
else
return end()-4;
}
G8RCClass::G8RCClass() : TargetRegisterClass(G8RCRegClassID, "G8RC", G8RCVTs, G8RCSubclasses, G8RCSuperclasses, G8RCSubRegClasses, G8RCSuperRegClasses, 8, 8, 1, G8RC, G8RC + 33) {}
GPRCClass::iterator
GPRCClass::allocation_order_begin(const MachineFunction &MF) const {
// 32-bit SVR4 ABI: r2 is reserved for the OS.
// 64-bit SVR4 ABI: r2 is reserved for the TOC pointer.
// Darwin: R2 is reserved for CR save/restore sequence.
return begin()+1;
}
GPRCClass::iterator
GPRCClass::allocation_order_end(const MachineFunction &MF) const {
// On PPC64, r13 is the thread pointer. Never allocate this register.
// Note that this is overconservative, as it also prevents allocation of
// R31 when the FP is not needed.
// When using the 32-bit SVR4 ABI, r13 is reserved for the Small Data Area
// pointer.
const PPCSubtarget &Subtarget
= MF.getTarget().getSubtarget<PPCSubtarget>();
if (Subtarget.isPPC64() || Subtarget.isSVR4ABI())
return end()-5; // don't allocate R13, R31, R0, R1, LR
if (needsFP(MF))
return end()-4; // don't allocate R31, R0, R1, LR
else
return end()-3; // don't allocate R0, R1, LR
}
GPRCClass::GPRCClass() : TargetRegisterClass(GPRCRegClassID, "GPRC", GPRCVTs, GPRCSubclasses, GPRCSuperclasses, GPRCSubRegClasses, GPRCSuperRegClasses, 4, 4, 1, GPRC, GPRC + 33) {}
VRRCClass::VRRCClass() : TargetRegisterClass(VRRCRegClassID, "VRRC", VRRCVTs, VRRCSubclasses, VRRCSuperclasses, VRRCSubRegClasses, VRRCSuperRegClasses, 16, 16, 1, VRRC, VRRC + 32) {}
VRSAVERCClass::VRSAVERCClass() : TargetRegisterClass(VRSAVERCRegClassID, "VRSAVERC", VRSAVERCVTs, VRSAVERCSubclasses, VRSAVERCSuperclasses, VRSAVERCSubRegClasses, VRSAVERCSuperRegClasses, 4, 4, 1, VRSAVERC, VRSAVERC + 1) {}
}
namespace {
const TargetRegisterClass* const RegisterClasses[] = {
&PPC::CARRYRCRegClass,
&PPC::CRBITRCRegClass,
&PPC::CRRCRegClass,
&PPC::CTRRCRegClass,
&PPC::CTRRC8RegClass,
&PPC::F4RCRegClass,
&PPC::F8RCRegClass,
&PPC::G8RCRegClass,
&PPC::GPRCRegClass,
&PPC::VRRCRegClass,
&PPC::VRSAVERCRegClass,
};
// Number of hash collisions: 11
const unsigned SubregHashTable[] = { PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X15, PPC::R15,
PPC::NoRegister, PPC::NoRegister,
PPC::CR2, PPC::CR2GT,
PPC::NoRegister, PPC::NoRegister,
PPC::CR7, PPC::CR7UN,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X2, PPC::R2,
PPC::NoRegister, PPC::NoRegister,
PPC::X29, PPC::R29,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X16, PPC::R16,
PPC::CR2, PPC::CR2LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X3, PPC::R3,
PPC::NoRegister, PPC::NoRegister,
PPC::X30, PPC::R30,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5GT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR2, PPC::CR2UN,
PPC::NoRegister, PPC::NoRegister,
PPC::X17, PPC::R17,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X4, PPC::R4,
PPC::NoRegister, PPC::NoRegister,
PPC::X31, PPC::R31,
PPC::CR0, PPC::CR0EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X18, PPC::R18,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X5, PPC::R5,
PPC::NoRegister, PPC::NoRegister,
PPC::CR0, PPC::CR0GT,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5UN,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X19, PPC::R19,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR3, PPC::CR3EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X6, PPC::R6,
PPC::CR0, PPC::CR0LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X20, PPC::R20,
PPC::NoRegister, PPC::NoRegister,
PPC::CR3, PPC::CR3GT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR0, PPC::CR0UN,
PPC::NoRegister, PPC::NoRegister,
PPC::X7, PPC::R7,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR6, PPC::CR6EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
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const unsigned SubregHashTableSize = 512;
// Number of hash collisions: 11
const unsigned AliasesHashTable[] = { PPC::NoRegister, PPC::NoRegister,
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const unsigned CR3GT_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR3LT_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR3UN_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR4_AliasSet[] = { PPC::CR4LT, PPC::CR4GT, PPC::CR4EQ, PPC::CR4UN, 0 };
const unsigned CR4EQ_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4GT_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4LT_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4UN_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR5_AliasSet[] = { PPC::CR5LT, PPC::CR5GT, PPC::CR5EQ, PPC::CR5UN, 0 };
const unsigned CR5EQ_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5GT_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5LT_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5UN_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR6_AliasSet[] = { PPC::CR6LT, PPC::CR6GT, PPC::CR6EQ, PPC::CR6UN, 0 };
const unsigned CR6EQ_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6GT_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6LT_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6UN_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR7_AliasSet[] = { PPC::CR7LT, PPC::CR7GT, PPC::CR7EQ, PPC::CR7UN, 0 };
const unsigned CR7EQ_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7GT_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7LT_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7UN_AliasSet[] = { PPC::CR7, 0 };
const unsigned R0_AliasSet[] = { PPC::X0, 0 };
const unsigned R1_AliasSet[] = { PPC::X1, 0 };
const unsigned R2_AliasSet[] = { PPC::X2, 0 };
const unsigned R3_AliasSet[] = { PPC::X3, 0 };
const unsigned R4_AliasSet[] = { PPC::X4, 0 };
const unsigned R5_AliasSet[] = { PPC::X5, 0 };
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const unsigned R19_AliasSet[] = { PPC::X19, 0 };
const unsigned R20_AliasSet[] = { PPC::X20, 0 };
const unsigned R21_AliasSet[] = { PPC::X21, 0 };
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const unsigned R30_AliasSet[] = { PPC::X30, 0 };
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const unsigned X20_AliasSet[] = { PPC::R20, 0 };
const unsigned X21_AliasSet[] = { PPC::R21, 0 };
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const unsigned X23_AliasSet[] = { PPC::R23, 0 };
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const unsigned X29_AliasSet[] = { PPC::R29, 0 };
const unsigned X30_AliasSet[] = { PPC::R30, 0 };
const unsigned X31_AliasSet[] = { PPC::R31, 0 };
// Register Sub-registers Sets...
const unsigned Empty_SubRegsSet[] = { 0 };
const unsigned CR0_SubRegsSet[] = { PPC::CR0LT, PPC::CR0GT, PPC::CR0EQ, PPC::CR0UN, 0 };
const unsigned CR1_SubRegsSet[] = { PPC::CR1LT, PPC::CR1GT, PPC::CR1EQ, PPC::CR1UN, 0 };
const unsigned CR2_SubRegsSet[] = { PPC::CR2LT, PPC::CR2GT, PPC::CR2EQ, PPC::CR2UN, 0 };
const unsigned CR3_SubRegsSet[] = { PPC::CR3LT, PPC::CR3GT, PPC::CR3EQ, PPC::CR3UN, 0 };
const unsigned CR4_SubRegsSet[] = { PPC::CR4LT, PPC::CR4GT, PPC::CR4EQ, PPC::CR4UN, 0 };
const unsigned CR5_SubRegsSet[] = { PPC::CR5LT, PPC::CR5GT, PPC::CR5EQ, PPC::CR5UN, 0 };
const unsigned CR6_SubRegsSet[] = { PPC::CR6LT, PPC::CR6GT, PPC::CR6EQ, PPC::CR6UN, 0 };
const unsigned CR7_SubRegsSet[] = { PPC::CR7LT, PPC::CR7GT, PPC::CR7EQ, PPC::CR7UN, 0 };
const unsigned X0_SubRegsSet[] = { PPC::R0, 0 };
const unsigned X1_SubRegsSet[] = { PPC::R1, 0 };
const unsigned X2_SubRegsSet[] = { PPC::R2, 0 };
const unsigned X3_SubRegsSet[] = { PPC::R3, 0 };
const unsigned X4_SubRegsSet[] = { PPC::R4, 0 };
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const unsigned X31_SubRegsSet[] = { PPC::R31, 0 };
// Register Super-registers Sets...
const unsigned Empty_SuperRegsSet[] = { 0 };
const unsigned CR0EQ_SuperRegsSet[] = { PPC::CR0, 0 };
const unsigned CR0GT_SuperRegsSet[] = { PPC::CR0, 0 };
const unsigned CR0LT_SuperRegsSet[] = { PPC::CR0, 0 };
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const unsigned CR1GT_SuperRegsSet[] = { PPC::CR1, 0 };
const unsigned CR1LT_SuperRegsSet[] = { PPC::CR1, 0 };
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const unsigned CR2EQ_SuperRegsSet[] = { PPC::CR2, 0 };
const unsigned CR2GT_SuperRegsSet[] = { PPC::CR2, 0 };
const unsigned CR2LT_SuperRegsSet[] = { PPC::CR2, 0 };
const unsigned CR2UN_SuperRegsSet[] = { PPC::CR2, 0 };
const unsigned CR3EQ_SuperRegsSet[] = { PPC::CR3, 0 };
const unsigned CR3GT_SuperRegsSet[] = { PPC::CR3, 0 };
const unsigned CR3LT_SuperRegsSet[] = { PPC::CR3, 0 };
const unsigned CR3UN_SuperRegsSet[] = { PPC::CR3, 0 };
const unsigned CR4EQ_SuperRegsSet[] = { PPC::CR4, 0 };
const unsigned CR4GT_SuperRegsSet[] = { PPC::CR4, 0 };
const unsigned CR4LT_SuperRegsSet[] = { PPC::CR4, 0 };
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const unsigned R29_SuperRegsSet[] = { PPC::X29, 0 };
const unsigned R30_SuperRegsSet[] = { PPC::X30, 0 };
const unsigned R31_SuperRegsSet[] = { PPC::X31, 0 };
const TargetRegisterDesc RegisterDescriptors[] = { // Descriptors
{ "NOREG", 0, 0, 0 },
{ "CARRY", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "CR0", CR0_AliasSet, CR0_SubRegsSet, Empty_SuperRegsSet },
{ "CR0EQ", CR0EQ_AliasSet, Empty_SubRegsSet, CR0EQ_SuperRegsSet },
{ "CR0GT", CR0GT_AliasSet, Empty_SubRegsSet, CR0GT_SuperRegsSet },
{ "CR0LT", CR0LT_AliasSet, Empty_SubRegsSet, CR0LT_SuperRegsSet },
{ "CR0UN", CR0UN_AliasSet, Empty_SubRegsSet, CR0UN_SuperRegsSet },
{ "CR1", CR1_AliasSet, CR1_SubRegsSet, Empty_SuperRegsSet },
{ "CR1EQ", CR1EQ_AliasSet, Empty_SubRegsSet, CR1EQ_SuperRegsSet },
{ "CR1GT", CR1GT_AliasSet, Empty_SubRegsSet, CR1GT_SuperRegsSet },
{ "CR1LT", CR1LT_AliasSet, Empty_SubRegsSet, CR1LT_SuperRegsSet },
{ "CR1UN", CR1UN_AliasSet, Empty_SubRegsSet, CR1UN_SuperRegsSet },
{ "CR2", CR2_AliasSet, CR2_SubRegsSet, Empty_SuperRegsSet },
{ "CR2EQ", CR2EQ_AliasSet, Empty_SubRegsSet, CR2EQ_SuperRegsSet },
{ "CR2GT", CR2GT_AliasSet, Empty_SubRegsSet, CR2GT_SuperRegsSet },
{ "CR2LT", CR2LT_AliasSet, Empty_SubRegsSet, CR2LT_SuperRegsSet },
{ "CR2UN", CR2UN_AliasSet, Empty_SubRegsSet, CR2UN_SuperRegsSet },
{ "CR3", CR3_AliasSet, CR3_SubRegsSet, Empty_SuperRegsSet },
{ "CR3EQ", CR3EQ_AliasSet, Empty_SubRegsSet, CR3EQ_SuperRegsSet },
{ "CR3GT", CR3GT_AliasSet, Empty_SubRegsSet, CR3GT_SuperRegsSet },
{ "CR3LT", CR3LT_AliasSet, Empty_SubRegsSet, CR3LT_SuperRegsSet },
{ "CR3UN", CR3UN_AliasSet, Empty_SubRegsSet, CR3UN_SuperRegsSet },
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{ "CR6EQ", CR6EQ_AliasSet, Empty_SubRegsSet, CR6EQ_SuperRegsSet },
{ "CR6GT", CR6GT_AliasSet, Empty_SubRegsSet, CR6GT_SuperRegsSet },
{ "CR6LT", CR6LT_AliasSet, Empty_SubRegsSet, CR6LT_SuperRegsSet },
{ "CR6UN", CR6UN_AliasSet, Empty_SubRegsSet, CR6UN_SuperRegsSet },
{ "CR7", CR7_AliasSet, CR7_SubRegsSet, Empty_SuperRegsSet },
{ "CR7EQ", CR7EQ_AliasSet, Empty_SubRegsSet, CR7EQ_SuperRegsSet },
{ "CR7GT", CR7GT_AliasSet, Empty_SubRegsSet, CR7GT_SuperRegsSet },
{ "CR7LT", CR7LT_AliasSet, Empty_SubRegsSet, CR7LT_SuperRegsSet },
{ "CR7UN", CR7UN_AliasSet, Empty_SubRegsSet, CR7UN_SuperRegsSet },
{ "CTR", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "CTR8", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F0", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F1", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F2", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F3", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F4", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F5", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F6", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F7", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F8", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F9", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F10", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F11", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F12", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "F13", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
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{ "LR", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "LR8", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
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{ "R31", R31_AliasSet, Empty_SubRegsSet, R31_SuperRegsSet },
{ "RM", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
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{ "V14", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V15", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V16", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V17", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V18", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V19", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V20", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V21", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
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{ "V26", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V27", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V28", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V29", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V30", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "V31", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "VRSAVE", Empty_AliasSet, Empty_SubRegsSet, Empty_SuperRegsSet },
{ "X0", X0_AliasSet, X0_SubRegsSet, Empty_SuperRegsSet },
{ "X1", X1_AliasSet, X1_SubRegsSet, Empty_SuperRegsSet },
{ "X2", X2_AliasSet, X2_SubRegsSet, Empty_SuperRegsSet },
{ "X3", X3_AliasSet, X3_SubRegsSet, Empty_SuperRegsSet },
{ "X4", X4_AliasSet, X4_SubRegsSet, Empty_SuperRegsSet },
{ "X5", X5_AliasSet, X5_SubRegsSet, Empty_SuperRegsSet },
{ "X6", X6_AliasSet, X6_SubRegsSet, Empty_SuperRegsSet },
{ "X7", X7_AliasSet, X7_SubRegsSet, Empty_SuperRegsSet },
{ "X8", X8_AliasSet, X8_SubRegsSet, Empty_SuperRegsSet },
{ "X9", X9_AliasSet, X9_SubRegsSet, Empty_SuperRegsSet },
{ "X10", X10_AliasSet, X10_SubRegsSet, Empty_SuperRegsSet },
{ "X11", X11_AliasSet, X11_SubRegsSet, Empty_SuperRegsSet },
{ "X12", X12_AliasSet, X12_SubRegsSet, Empty_SuperRegsSet },
{ "X13", X13_AliasSet, X13_SubRegsSet, Empty_SuperRegsSet },
{ "X14", X14_AliasSet, X14_SubRegsSet, Empty_SuperRegsSet },
{ "X15", X15_AliasSet, X15_SubRegsSet, Empty_SuperRegsSet },
{ "X16", X16_AliasSet, X16_SubRegsSet, Empty_SuperRegsSet },
{ "X17", X17_AliasSet, X17_SubRegsSet, Empty_SuperRegsSet },
{ "X18", X18_AliasSet, X18_SubRegsSet, Empty_SuperRegsSet },
{ "X19", X19_AliasSet, X19_SubRegsSet, Empty_SuperRegsSet },
{ "X20", X20_AliasSet, X20_SubRegsSet, Empty_SuperRegsSet },
{ "X21", X21_AliasSet, X21_SubRegsSet, Empty_SuperRegsSet },
{ "X22", X22_AliasSet, X22_SubRegsSet, Empty_SuperRegsSet },
{ "X23", X23_AliasSet, X23_SubRegsSet, Empty_SuperRegsSet },
{ "X24", X24_AliasSet, X24_SubRegsSet, Empty_SuperRegsSet },
{ "X25", X25_AliasSet, X25_SubRegsSet, Empty_SuperRegsSet },
{ "X26", X26_AliasSet, X26_SubRegsSet, Empty_SuperRegsSet },
{ "X27", X27_AliasSet, X27_SubRegsSet, Empty_SuperRegsSet },
{ "X28", X28_AliasSet, X28_SubRegsSet, Empty_SuperRegsSet },
{ "X29", X29_AliasSet, X29_SubRegsSet, Empty_SuperRegsSet },
{ "X30", X30_AliasSet, X30_SubRegsSet, Empty_SuperRegsSet },
{ "X31", X31_AliasSet, X31_SubRegsSet, Empty_SuperRegsSet },
};
const char *const SubRegIndexTable[] = { "sub_32", "sub_eq", "sub_gt", "sub_lt", "sub_un" };
}
unsigned PPCGenRegisterInfo::getSubReg(unsigned RegNo, unsigned Index) const {
switch (RegNo) {
default:
return 0;
case PPC::CR0:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR0EQ;
case PPC::sub_gt: return PPC::CR0GT;
case PPC::sub_lt: return PPC::CR0LT;
case PPC::sub_un: return PPC::CR0UN;
};
break;
case PPC::CR1:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR1EQ;
case PPC::sub_gt: return PPC::CR1GT;
case PPC::sub_lt: return PPC::CR1LT;
case PPC::sub_un: return PPC::CR1UN;
};
break;
case PPC::CR2:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR2EQ;
case PPC::sub_gt: return PPC::CR2GT;
case PPC::sub_lt: return PPC::CR2LT;
case PPC::sub_un: return PPC::CR2UN;
};
break;
case PPC::CR3:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR3EQ;
case PPC::sub_gt: return PPC::CR3GT;
case PPC::sub_lt: return PPC::CR3LT;
case PPC::sub_un: return PPC::CR3UN;
};
break;
case PPC::CR4:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR4EQ;
case PPC::sub_gt: return PPC::CR4GT;
case PPC::sub_lt: return PPC::CR4LT;
case PPC::sub_un: return PPC::CR4UN;
};
break;
case PPC::CR5:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR5EQ;
case PPC::sub_gt: return PPC::CR5GT;
case PPC::sub_lt: return PPC::CR5LT;
case PPC::sub_un: return PPC::CR5UN;
};
break;
case PPC::CR6:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR6EQ;
case PPC::sub_gt: return PPC::CR6GT;
case PPC::sub_lt: return PPC::CR6LT;
case PPC::sub_un: return PPC::CR6UN;
};
break;
case PPC::CR7:
switch (Index) {
default: return 0;
case PPC::sub_eq: return PPC::CR7EQ;
case PPC::sub_gt: return PPC::CR7GT;
case PPC::sub_lt: return PPC::CR7LT;
case PPC::sub_un: return PPC::CR7UN;
};
break;
case PPC::X0:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R0;
};
break;
case PPC::X1:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R1;
};
break;
case PPC::X2:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R2;
};
break;
case PPC::X3:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R3;
};
break;
case PPC::X4:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R4;
};
break;
case PPC::X5:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R5;
};
break;
case PPC::X6:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R6;
};
break;
case PPC::X7:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R7;
};
break;
case PPC::X8:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R8;
};
break;
case PPC::X9:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R9;
};
break;
case PPC::X10:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R10;
};
break;
case PPC::X11:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R11;
};
break;
case PPC::X12:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R12;
};
break;
case PPC::X13:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R13;
};
break;
case PPC::X14:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R14;
};
break;
case PPC::X15:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R15;
};
break;
case PPC::X16:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R16;
};
break;
case PPC::X17:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R17;
};
break;
case PPC::X18:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R18;
};
break;
case PPC::X19:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R19;
};
break;
case PPC::X20:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R20;
};
break;
case PPC::X21:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R21;
};
break;
case PPC::X22:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R22;
};
break;
case PPC::X23:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R23;
};
break;
case PPC::X24:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R24;
};
break;
case PPC::X25:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R25;
};
break;
case PPC::X26:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R26;
};
break;
case PPC::X27:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R27;
};
break;
case PPC::X28:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R28;
};
break;
case PPC::X29:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R29;
};
break;
case PPC::X30:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R30;
};
break;
case PPC::X31:
switch (Index) {
default: return 0;
case PPC::sub_32: return PPC::R31;
};
break;
};
return 0;
}
unsigned PPCGenRegisterInfo::getSubRegIndex(unsigned RegNo, unsigned SubRegNo) const {
switch (RegNo) {
default:
return 0;
case PPC::CR0:
if (SubRegNo == PPC::CR0EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR0GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR0LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR0UN) return PPC::sub_un;
return 0;
case PPC::CR1:
if (SubRegNo == PPC::CR1EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR1GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR1LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR1UN) return PPC::sub_un;
return 0;
case PPC::CR2:
if (SubRegNo == PPC::CR2EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR2GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR2LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR2UN) return PPC::sub_un;
return 0;
case PPC::CR3:
if (SubRegNo == PPC::CR3EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR3GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR3LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR3UN) return PPC::sub_un;
return 0;
case PPC::CR4:
if (SubRegNo == PPC::CR4EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR4GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR4LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR4UN) return PPC::sub_un;
return 0;
case PPC::CR5:
if (SubRegNo == PPC::CR5EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR5GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR5LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR5UN) return PPC::sub_un;
return 0;
case PPC::CR6:
if (SubRegNo == PPC::CR6EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR6GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR6LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR6UN) return PPC::sub_un;
return 0;
case PPC::CR7:
if (SubRegNo == PPC::CR7EQ) return PPC::sub_eq;
if (SubRegNo == PPC::CR7GT) return PPC::sub_gt;
if (SubRegNo == PPC::CR7LT) return PPC::sub_lt;
if (SubRegNo == PPC::CR7UN) return PPC::sub_un;
return 0;
case PPC::X0:
if (SubRegNo == PPC::R0) return PPC::sub_32;
return 0;
case PPC::X1:
if (SubRegNo == PPC::R1) return PPC::sub_32;
return 0;
case PPC::X2:
if (SubRegNo == PPC::R2) return PPC::sub_32;
return 0;
case PPC::X3:
if (SubRegNo == PPC::R3) return PPC::sub_32;
return 0;
case PPC::X4:
if (SubRegNo == PPC::R4) return PPC::sub_32;
return 0;
case PPC::X5:
if (SubRegNo == PPC::R5) return PPC::sub_32;
return 0;
case PPC::X6:
if (SubRegNo == PPC::R6) return PPC::sub_32;
return 0;
case PPC::X7:
if (SubRegNo == PPC::R7) return PPC::sub_32;
return 0;
case PPC::X8:
if (SubRegNo == PPC::R8) return PPC::sub_32;
return 0;
case PPC::X9:
if (SubRegNo == PPC::R9) return PPC::sub_32;
return 0;
case PPC::X10:
if (SubRegNo == PPC::R10) return PPC::sub_32;
return 0;
case PPC::X11:
if (SubRegNo == PPC::R11) return PPC::sub_32;
return 0;
case PPC::X12:
if (SubRegNo == PPC::R12) return PPC::sub_32;
return 0;
case PPC::X13:
if (SubRegNo == PPC::R13) return PPC::sub_32;
return 0;
case PPC::X14:
if (SubRegNo == PPC::R14) return PPC::sub_32;
return 0;
case PPC::X15:
if (SubRegNo == PPC::R15) return PPC::sub_32;
return 0;
case PPC::X16:
if (SubRegNo == PPC::R16) return PPC::sub_32;
return 0;
case PPC::X17:
if (SubRegNo == PPC::R17) return PPC::sub_32;
return 0;
case PPC::X18:
if (SubRegNo == PPC::R18) return PPC::sub_32;
return 0;
case PPC::X19:
if (SubRegNo == PPC::R19) return PPC::sub_32;
return 0;
case PPC::X20:
if (SubRegNo == PPC::R20) return PPC::sub_32;
return 0;
case PPC::X21:
if (SubRegNo == PPC::R21) return PPC::sub_32;
return 0;
case PPC::X22:
if (SubRegNo == PPC::R22) return PPC::sub_32;
return 0;
case PPC::X23:
if (SubRegNo == PPC::R23) return PPC::sub_32;
return 0;
case PPC::X24:
if (SubRegNo == PPC::R24) return PPC::sub_32;
return 0;
case PPC::X25:
if (SubRegNo == PPC::R25) return PPC::sub_32;
return 0;
case PPC::X26:
if (SubRegNo == PPC::R26) return PPC::sub_32;
return 0;
case PPC::X27:
if (SubRegNo == PPC::R27) return PPC::sub_32;
return 0;
case PPC::X28:
if (SubRegNo == PPC::R28) return PPC::sub_32;
return 0;
case PPC::X29:
if (SubRegNo == PPC::R29) return PPC::sub_32;
return 0;
case PPC::X30:
if (SubRegNo == PPC::R30) return PPC::sub_32;
return 0;
case PPC::X31:
if (SubRegNo == PPC::R31) return PPC::sub_32;
return 0;
};
return 0;
}
unsigned PPCGenRegisterInfo::composeSubRegIndices(unsigned IdxA, unsigned IdxB) const {
switch (IdxA) {
default:
return IdxB;
}
}
PPCGenRegisterInfo::PPCGenRegisterInfo(int CallFrameSetupOpcode, int CallFrameDestroyOpcode)
: TargetRegisterInfo(RegisterDescriptors, 176, RegisterClasses, RegisterClasses+11,
SubRegIndexTable,
CallFrameSetupOpcode, CallFrameDestroyOpcode,
SubregHashTable, SubregHashTableSize,
AliasesHashTable, AliasesHashTableSize) {
}
int PPCGenRegisterInfo::getDwarfRegNumFull(unsigned RegNum, unsigned Flavour) const {
switch (Flavour) {
default:
assert(0 && "Unknown DWARF flavour");
return -1;
case 0:
switch (RegNum) {
default:
assert(0 && "Invalid RegNum");
return -1;
case PPC::CARRY:
return 0;
case PPC::CR0:
return 68;
case PPC::CR0EQ:
return 0;
case PPC::CR0GT:
return 0;
case PPC::CR0LT:
return 0;
case PPC::CR0UN:
return 0;
case PPC::CR1:
return 69;
case PPC::CR1EQ:
return 0;
case PPC::CR1GT:
return 0;
case PPC::CR1LT:
return 0;
case PPC::CR1UN:
return 0;
case PPC::CR2:
return 70;
case PPC::CR2EQ:
return 0;
case PPC::CR2GT:
return 0;
case PPC::CR2LT:
return 0;
case PPC::CR2UN:
return 0;
case PPC::CR3:
return 71;
case PPC::CR3EQ:
return 0;
case PPC::CR3GT:
return 0;
case PPC::CR3LT:
return 0;
case PPC::CR3UN:
return 0;
case PPC::CR4:
return 72;
case PPC::CR4EQ:
return 0;
case PPC::CR4GT:
return 0;
case PPC::CR4LT:
return 0;
case PPC::CR4UN:
return 0;
case PPC::CR5:
return 73;
case PPC::CR5EQ:
return 0;
case PPC::CR5GT:
return 0;
case PPC::CR5LT:
return 0;
case PPC::CR5UN:
return 0;
case PPC::CR6:
return 74;
case PPC::CR6EQ:
return 0;
case PPC::CR6GT:
return 0;
case PPC::CR6LT:
return 0;
case PPC::CR6UN:
return 0;
case PPC::CR7:
return 75;
case PPC::CR7EQ:
return 0;
case PPC::CR7GT:
return 0;
case PPC::CR7LT:
return 0;
case PPC::CR7UN:
return 0;
case PPC::CTR:
return 66;
case PPC::CTR8:
return 66;
case PPC::F0:
return 32;
case PPC::F1:
return 33;
case PPC::F2:
return 34;
case PPC::F3:
return 35;
case PPC::F4:
return 36;
case PPC::F5:
return 37;
case PPC::F6:
return 38;
case PPC::F7:
return 39;
case PPC::F8:
return 40;
case PPC::F9:
return 41;
case PPC::F10:
return 42;
case PPC::F11:
return 43;
case PPC::F12:
return 44;
case PPC::F13:
return 45;
case PPC::F14:
return 46;
case PPC::F15:
return 47;
case PPC::F16:
return 48;
case PPC::F17:
return 49;
case PPC::F18:
return 50;
case PPC::F19:
return 51;
case PPC::F20:
return 52;
case PPC::F21:
return 53;
case PPC::F22:
return 54;
case PPC::F23:
return 55;
case PPC::F24:
return 56;
case PPC::F25:
return 57;
case PPC::F26:
return 58;
case PPC::F27:
return 59;
case PPC::F28:
return 60;
case PPC::F29:
return 61;
case PPC::F30:
return 62;
case PPC::F31:
return 63;
case PPC::LR:
return 65;
case PPC::LR8:
return 65;
case PPC::R0:
return 0;
case PPC::R1:
return 1;
case PPC::R2:
return 2;
case PPC::R3:
return 3;
case PPC::R4:
return 4;
case PPC::R5:
return 5;
case PPC::R6:
return 6;
case PPC::R7:
return 7;
case PPC::R8:
return 8;
case PPC::R9:
return 9;
case PPC::R10:
return 10;
case PPC::R11:
return 11;
case PPC::R12:
return 12;
case PPC::R13:
return 13;
case PPC::R14:
return 14;
case PPC::R15:
return 15;
case PPC::R16:
return 16;
case PPC::R17:
return 17;
case PPC::R18:
return 18;
case PPC::R19:
return 19;
case PPC::R20:
return 20;
case PPC::R21:
return 21;
case PPC::R22:
return 22;
case PPC::R23:
return 23;
case PPC::R24:
return 24;
case PPC::R25:
return 25;
case PPC::R26:
return 26;
case PPC::R27:
return 27;
case PPC::R28:
return 28;
case PPC::R29:
return 29;
case PPC::R30:
return 30;
case PPC::R31:
return 31;
case PPC::RM:
return 0;
case PPC::V0:
return 77;
case PPC::V1:
return 78;
case PPC::V2:
return 79;
case PPC::V3:
return 80;
case PPC::V4:
return 81;
case PPC::V5:
return 82;
case PPC::V6:
return 83;
case PPC::V7:
return 84;
case PPC::V8:
return 85;
case PPC::V9:
return 86;
case PPC::V10:
return 87;
case PPC::V11:
return 88;
case PPC::V12:
return 89;
case PPC::V13:
return 90;
case PPC::V14:
return 91;
case PPC::V15:
return 92;
case PPC::V16:
return 93;
case PPC::V17:
return 94;
case PPC::V18:
return 95;
case PPC::V19:
return 96;
case PPC::V20:
return 97;
case PPC::V21:
return 98;
case PPC::V22:
return 99;
case PPC::V23:
return 100;
case PPC::V24:
return 101;
case PPC::V25:
return 102;
case PPC::V26:
return 103;
case PPC::V27:
return 104;
case PPC::V28:
return 105;
case PPC::V29:
return 106;
case PPC::V30:
return 107;
case PPC::V31:
return 108;
case PPC::VRSAVE:
return 107;
case PPC::X0:
return 0;
case PPC::X1:
return 1;
case PPC::X2:
return 2;
case PPC::X3:
return 3;
case PPC::X4:
return 4;
case PPC::X5:
return 5;
case PPC::X6:
return 6;
case PPC::X7:
return 7;
case PPC::X8:
return 8;
case PPC::X9:
return 9;
case PPC::X10:
return 10;
case PPC::X11:
return 11;
case PPC::X12:
return 12;
case PPC::X13:
return 13;
case PPC::X14:
return 14;
case PPC::X15:
return 15;
case PPC::X16:
return 16;
case PPC::X17:
return 17;
case PPC::X18:
return 18;
case PPC::X19:
return 19;
case PPC::X20:
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