//===- TableGen'erated file -------------------------------------*- C++ -*-===//
//
// Register Information Source Fragment
//
// Automatically generated file, do not edit!
//
//===----------------------------------------------------------------------===//
namespace llvm {
namespace { // Register classes...
// CARRYRC Register Class...
static const unsigned CARRYRC[] = {
PPC::CARRY,
};
// CRBITRC Register Class...
static const unsigned CRBITRC[] = {
PPC::CR0LT, PPC::CR0GT, PPC::CR0EQ, PPC::CR0UN, PPC::CR1LT, PPC::CR1GT, PPC::CR1EQ, PPC::CR1UN, PPC::CR2LT, PPC::CR2GT, PPC::CR2EQ, PPC::CR2UN, PPC::CR3LT, PPC::CR3GT, PPC::CR3EQ, PPC::CR3UN, PPC::CR4LT, PPC::CR4GT, PPC::CR4EQ, PPC::CR4UN, PPC::CR5LT, PPC::CR5GT, PPC::CR5EQ, PPC::CR5UN, PPC::CR6LT, PPC::CR6GT, PPC::CR6EQ, PPC::CR6UN, PPC::CR7LT, PPC::CR7GT, PPC::CR7EQ, PPC::CR7UN,
};
// CRRC Register Class...
static const unsigned CRRC[] = {
PPC::CR0, PPC::CR1, PPC::CR5, PPC::CR6, PPC::CR7, PPC::CR2, PPC::CR3, PPC::CR4,
};
// CTRRC Register Class...
static const unsigned CTRRC[] = {
PPC::CTR,
};
// CTRRC8 Register Class...
static const unsigned CTRRC8[] = {
PPC::CTR8,
};
// F4RC Register Class...
static const unsigned F4RC[] = {
PPC::F0, PPC::F1, PPC::F2, PPC::F3, PPC::F4, PPC::F5, PPC::F6, PPC::F7, PPC::F8, PPC::F9, PPC::F10, PPC::F11, PPC::F12, PPC::F13, PPC::F31, PPC::F30, PPC::F29, PPC::F28, PPC::F27, PPC::F26, PPC::F25, PPC::F24, PPC::F23, PPC::F22, PPC::F21, PPC::F20, PPC::F19, PPC::F18, PPC::F17, PPC::F16, PPC::F15, PPC::F14,
};
// F8RC Register Class...
static const unsigned F8RC[] = {
PPC::F0, PPC::F1, PPC::F2, PPC::F3, PPC::F4, PPC::F5, PPC::F6, PPC::F7, PPC::F8, PPC::F9, PPC::F10, PPC::F11, PPC::F12, PPC::F13, PPC::F31, PPC::F30, PPC::F29, PPC::F28, PPC::F27, PPC::F26, PPC::F25, PPC::F24, PPC::F23, PPC::F22, PPC::F21, PPC::F20, PPC::F19, PPC::F18, PPC::F17, PPC::F16, PPC::F15, PPC::F14,
};
// G8RC Register Class...
static const unsigned G8RC[] = {
PPC::X2, PPC::X3, PPC::X4, PPC::X5, PPC::X6, PPC::X7, PPC::X8, PPC::X9, PPC::X10, PPC::X11, PPC::X12, PPC::X30, PPC::X29, PPC::X28, PPC::X27, PPC::X26, PPC::X25, PPC::X24, PPC::X23, PPC::X22, PPC::X21, PPC::X20, PPC::X19, PPC::X18, PPC::X17, PPC::X16, PPC::X15, PPC::X14, PPC::X31, PPC::X13, PPC::X0, PPC::X1, PPC::LR8,
};
// GPRC Register Class...
static const unsigned GPRC[] = {
PPC::R2, PPC::R3, PPC::R4, PPC::R5, PPC::R6, PPC::R7, PPC::R8, PPC::R9, PPC::R10, PPC::R11, PPC::R12, PPC::R30, PPC::R29, PPC::R28, PPC::R27, PPC::R26, PPC::R25, PPC::R24, PPC::R23, PPC::R22, PPC::R21, PPC::R20, PPC::R19, PPC::R18, PPC::R17, PPC::R16, PPC::R15, PPC::R14, PPC::R13, PPC::R31, PPC::R0, PPC::R1, PPC::LR,
};
// VRRC Register Class...
static const unsigned VRRC[] = {
PPC::V2, PPC::V3, PPC::V4, PPC::V5, PPC::V0, PPC::V1, PPC::V6, PPC::V7, PPC::V8, PPC::V9, PPC::V10, PPC::V11, PPC::V12, PPC::V13, PPC::V14, PPC::V15, PPC::V16, PPC::V17, PPC::V18, PPC::V19, PPC::V31, PPC::V30, PPC::V29, PPC::V28, PPC::V27, PPC::V26, PPC::V25, PPC::V24, PPC::V23, PPC::V22, PPC::V21, PPC::V20,
};
// VRSAVERC Register Class...
static const unsigned VRSAVERC[] = {
PPC::VRSAVE,
};
// CARRYRCVTs Register Class Value Types...
static const EVT CARRYRCVTs[] = {
MVT::i32, MVT::Other
};
// CRBITRCVTs Register Class Value Types...
static const EVT CRBITRCVTs[] = {
MVT::i32, MVT::Other
};
// CRRCVTs Register Class Value Types...
static const EVT CRRCVTs[] = {
MVT::i32, MVT::Other
};
// CTRRCVTs Register Class Value Types...
static const EVT CTRRCVTs[] = {
MVT::i32, MVT::Other
};
// CTRRC8VTs Register Class Value Types...
static const EVT CTRRC8VTs[] = {
MVT::i64, MVT::Other
};
// F4RCVTs Register Class Value Types...
static const EVT F4RCVTs[] = {
MVT::f32, MVT::Other
};
// F8RCVTs Register Class Value Types...
static const EVT F8RCVTs[] = {
MVT::f64, MVT::Other
};
// G8RCVTs Register Class Value Types...
static const EVT G8RCVTs[] = {
MVT::i64, MVT::Other
};
// GPRCVTs Register Class Value Types...
static const EVT GPRCVTs[] = {
MVT::i32, MVT::Other
};
// VRRCVTs Register Class Value Types...
static const EVT VRRCVTs[] = {
MVT::v16i8, MVT::v8i16, MVT::v4i32, MVT::v4f32, MVT::Other
};
// VRSAVERCVTs Register Class Value Types...
static const EVT VRSAVERCVTs[] = {
MVT::i32, MVT::Other
};
} // end anonymous namespace
namespace PPC { // Register class instances
CARRYRCClass CARRYRCRegClass;
CRBITRCClass CRBITRCRegClass;
CRRCClass CRRCRegClass;
CTRRCClass CTRRCRegClass;
CTRRC8Class CTRRC8RegClass;
F4RCClass F4RCRegClass;
F8RCClass F8RCRegClass;
G8RCClass G8RCRegClass;
GPRCClass GPRCRegClass;
VRRCClass VRRCRegClass;
VRSAVERCClass VRSAVERCRegClass;
// CARRYRC Sub-register Classes...
static const TargetRegisterClass* const CARRYRCSubRegClasses[] = {
NULL
};
// CRBITRC Sub-register Classes...
static const TargetRegisterClass* const CRBITRCSubRegClasses[] = {
NULL
};
// CRRC Sub-register Classes...
static const TargetRegisterClass* const CRRCSubRegClasses[] = {
&PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass, &PPC::CRBITRCRegClass, NULL
};
// CTRRC Sub-register Classes...
static const TargetRegisterClass* const CTRRCSubRegClasses[] = {
NULL
};
// CTRRC8 Sub-register Classes...
static const TargetRegisterClass* const CTRRC8SubRegClasses[] = {
NULL
};
// F4RC Sub-register Classes...
static const TargetRegisterClass* const F4RCSubRegClasses[] = {
NULL
};
// F8RC Sub-register Classes...
static const TargetRegisterClass* const F8RCSubRegClasses[] = {
NULL
};
// G8RC Sub-register Classes...
static const TargetRegisterClass* const G8RCSubRegClasses[] = {
NULL
};
// GPRC Sub-register Classes...
static const TargetRegisterClass* const GPRCSubRegClasses[] = {
NULL
};
// VRRC Sub-register Classes...
static const TargetRegisterClass* const VRRCSubRegClasses[] = {
NULL
};
// VRSAVERC Sub-register Classes...
static const TargetRegisterClass* const VRSAVERCSubRegClasses[] = {
NULL
};
// CARRYRC Super-register Classes...
static const TargetRegisterClass* const CARRYRCSuperRegClasses[] = {
NULL
};
// CRBITRC Super-register Classes...
static const TargetRegisterClass* const CRBITRCSuperRegClasses[] = {
&PPC::CRRCRegClass, NULL
};
// CRRC Super-register Classes...
static const TargetRegisterClass* const CRRCSuperRegClasses[] = {
NULL
};
// CTRRC Super-register Classes...
static const TargetRegisterClass* const CTRRCSuperRegClasses[] = {
NULL
};
// CTRRC8 Super-register Classes...
static const TargetRegisterClass* const CTRRC8SuperRegClasses[] = {
NULL
};
// F4RC Super-register Classes...
static const TargetRegisterClass* const F4RCSuperRegClasses[] = {
NULL
};
// F8RC Super-register Classes...
static const TargetRegisterClass* const F8RCSuperRegClasses[] = {
NULL
};
// G8RC Super-register Classes...
static const TargetRegisterClass* const G8RCSuperRegClasses[] = {
NULL
};
// GPRC Super-register Classes...
static const TargetRegisterClass* const GPRCSuperRegClasses[] = {
NULL
};
// VRRC Super-register Classes...
static const TargetRegisterClass* const VRRCSuperRegClasses[] = {
NULL
};
// VRSAVERC Super-register Classes...
static const TargetRegisterClass* const VRSAVERCSuperRegClasses[] = {
NULL
};
// CARRYRC Register Class sub-classes...
static const TargetRegisterClass* const CARRYRCSubclasses[] = {
NULL
};
// CRBITRC Register Class sub-classes...
static const TargetRegisterClass* const CRBITRCSubclasses[] = {
NULL
};
// CRRC Register Class sub-classes...
static const TargetRegisterClass* const CRRCSubclasses[] = {
NULL
};
// CTRRC Register Class sub-classes...
static const TargetRegisterClass* const CTRRCSubclasses[] = {
NULL
};
// CTRRC8 Register Class sub-classes...
static const TargetRegisterClass* const CTRRC8Subclasses[] = {
NULL
};
// F4RC Register Class sub-classes...
static const TargetRegisterClass* const F4RCSubclasses[] = {
&PPC::F8RCRegClass, NULL
};
// F8RC Register Class sub-classes...
static const TargetRegisterClass* const F8RCSubclasses[] = {
NULL
};
// G8RC Register Class sub-classes...
static const TargetRegisterClass* const G8RCSubclasses[] = {
NULL
};
// GPRC Register Class sub-classes...
static const TargetRegisterClass* const GPRCSubclasses[] = {
NULL
};
// VRRC Register Class sub-classes...
static const TargetRegisterClass* const VRRCSubclasses[] = {
NULL
};
// VRSAVERC Register Class sub-classes...
static const TargetRegisterClass* const VRSAVERCSubclasses[] = {
NULL
};
// CARRYRC Register Class super-classes...
static const TargetRegisterClass* const CARRYRCSuperclasses[] = {
NULL
};
// CRBITRC Register Class super-classes...
static const TargetRegisterClass* const CRBITRCSuperclasses[] = {
NULL
};
// CRRC Register Class super-classes...
static const TargetRegisterClass* const CRRCSuperclasses[] = {
NULL
};
// CTRRC Register Class super-classes...
static const TargetRegisterClass* const CTRRCSuperclasses[] = {
NULL
};
// CTRRC8 Register Class super-classes...
static const TargetRegisterClass* const CTRRC8Superclasses[] = {
NULL
};
// F4RC Register Class super-classes...
static const TargetRegisterClass* const F4RCSuperclasses[] = {
NULL
};
// F8RC Register Class super-classes...
static const TargetRegisterClass* const F8RCSuperclasses[] = {
&PPC::F4RCRegClass, NULL
};
// G8RC Register Class super-classes...
static const TargetRegisterClass* const G8RCSuperclasses[] = {
NULL
};
// GPRC Register Class super-classes...
static const TargetRegisterClass* const GPRCSuperclasses[] = {
NULL
};
// VRRC Register Class super-classes...
static const TargetRegisterClass* const VRRCSuperclasses[] = {
NULL
};
// VRSAVERC Register Class super-classes...
static const TargetRegisterClass* const VRSAVERCSuperclasses[] = {
NULL
};
CARRYRCClass::CARRYRCClass() : TargetRegisterClass(CARRYRCRegClassID, "CARRYRC", CARRYRCVTs, CARRYRCSubclasses, CARRYRCSuperclasses, CARRYRCSubRegClasses, CARRYRCSuperRegClasses, 4, 4, -1, CARRYRC, CARRYRC + 1) {}
CRBITRCClass::CRBITRCClass() : TargetRegisterClass(CRBITRCRegClassID, "CRBITRC", CRBITRCVTs, CRBITRCSubclasses, CRBITRCSuperclasses, CRBITRCSubRegClasses, CRBITRCSuperRegClasses, 4, 4, -1, CRBITRC, CRBITRC + 32) {}
CRRCClass::CRRCClass() : TargetRegisterClass(CRRCRegClassID, "CRRC", CRRCVTs, CRRCSubclasses, CRRCSuperclasses, CRRCSubRegClasses, CRRCSuperRegClasses, 4, 4, 1, CRRC, CRRC + 8) {}
CTRRCClass::CTRRCClass() : TargetRegisterClass(CTRRCRegClassID, "CTRRC", CTRRCVTs, CTRRCSubclasses, CTRRCSuperclasses, CTRRCSubRegClasses, CTRRCSuperRegClasses, 4, 4, 1, CTRRC, CTRRC + 1) {}
CTRRC8Class::CTRRC8Class() : TargetRegisterClass(CTRRC8RegClassID, "CTRRC8", CTRRC8VTs, CTRRC8Subclasses, CTRRC8Superclasses, CTRRC8SubRegClasses, CTRRC8SuperRegClasses, 8, 8, 1, CTRRC8, CTRRC8 + 1) {}
F4RCClass::F4RCClass() : TargetRegisterClass(F4RCRegClassID, "F4RC", F4RCVTs, F4RCSubclasses, F4RCSuperclasses, F4RCSubRegClasses, F4RCSuperRegClasses, 4, 4, 1, F4RC, F4RC + 32) {}
F8RCClass::F8RCClass() : TargetRegisterClass(F8RCRegClassID, "F8RC", F8RCVTs, F8RCSubclasses, F8RCSuperclasses, F8RCSubRegClasses, F8RCSuperRegClasses, 8, 8, 1, F8RC, F8RC + 32) {}
G8RCClass::iterator
G8RCClass::allocation_order_begin(const MachineFunction &MF) const {
// 64-bit SVR4 ABI: r2 is reserved for the TOC pointer.
// Darwin: r2 is reserved for CR save/restore sequence.
return begin()+1;
}
G8RCClass::iterator
G8RCClass::allocation_order_end(const MachineFunction &MF) const {
if (needsFP(MF))
return end()-5;
else
return end()-4;
}
G8RCClass::G8RCClass() : TargetRegisterClass(G8RCRegClassID, "G8RC", G8RCVTs, G8RCSubclasses, G8RCSuperclasses, G8RCSubRegClasses, G8RCSuperRegClasses, 8, 8, 1, G8RC, G8RC + 33) {}
GPRCClass::iterator
GPRCClass::allocation_order_begin(const MachineFunction &MF) const {
// 32-bit SVR4 ABI: r2 is reserved for the OS.
// 64-bit SVR4 ABI: r2 is reserved for the TOC pointer.
// Darwin: R2 is reserved for CR save/restore sequence.
return begin()+1;
}
GPRCClass::iterator
GPRCClass::allocation_order_end(const MachineFunction &MF) const {
// On PPC64, r13 is the thread pointer. Never allocate this register.
// Note that this is overconservative, as it also prevents allocation of
// R31 when the FP is not needed.
// When using the 32-bit SVR4 ABI, r13 is reserved for the Small Data Area
// pointer.
const PPCSubtarget &Subtarget
= MF.getTarget().getSubtarget<PPCSubtarget>();
if (Subtarget.isPPC64() || Subtarget.isSVR4ABI())
return end()-5; // don't allocate R13, R31, R0, R1, LR
if (needsFP(MF))
return end()-4; // don't allocate R31, R0, R1, LR
else
return end()-3; // don't allocate R0, R1, LR
}
GPRCClass::GPRCClass() : TargetRegisterClass(GPRCRegClassID, "GPRC", GPRCVTs, GPRCSubclasses, GPRCSuperclasses, GPRCSubRegClasses, GPRCSuperRegClasses, 4, 4, 1, GPRC, GPRC + 33) {}
VRRCClass::VRRCClass() : TargetRegisterClass(VRRCRegClassID, "VRRC", VRRCVTs, VRRCSubclasses, VRRCSuperclasses, VRRCSubRegClasses, VRRCSuperRegClasses, 16, 16, 1, VRRC, VRRC + 32) {}
VRSAVERCClass::VRSAVERCClass() : TargetRegisterClass(VRSAVERCRegClassID, "VRSAVERC", VRSAVERCVTs, VRSAVERCSubclasses, VRSAVERCSuperclasses, VRSAVERCSubRegClasses, VRSAVERCSuperRegClasses, 4, 4, 1, VRSAVERC, VRSAVERC + 1) {}
}
namespace {
const TargetRegisterClass* const RegisterClasses[] = {
&PPC::CARRYRCRegClass,
&PPC::CRBITRCRegClass,
&PPC::CRRCRegClass,
&PPC::CTRRCRegClass,
&PPC::CTRRC8RegClass,
&PPC::F4RCRegClass,
&PPC::F8RCRegClass,
&PPC::G8RCRegClass,
&PPC::GPRCRegClass,
&PPC::VRRCRegClass,
&PPC::VRSAVERCRegClass,
};
// Number of hash collisions: 11
const unsigned SubregHashTable[] = { PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X22, PPC::R22,
PPC::NoRegister, PPC::NoRegister,
PPC::CR2, PPC::CR2GT,
PPC::NoRegister, PPC::NoRegister,
PPC::CR7, PPC::CR7UN,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X10, PPC::R10,
PPC::NoRegister, PPC::NoRegister,
PPC::X7, PPC::R7,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X23, PPC::R23,
PPC::CR2, PPC::CR2LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X11, PPC::R11,
PPC::NoRegister, PPC::NoRegister,
PPC::X8, PPC::R8,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5GT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR2, PPC::CR2UN,
PPC::NoRegister, PPC::NoRegister,
PPC::X24, PPC::R24,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X12, PPC::R12,
PPC::NoRegister, PPC::NoRegister,
PPC::X9, PPC::R9,
PPC::CR0, PPC::CR0EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X25, PPC::R25,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X13, PPC::R13,
PPC::NoRegister, PPC::NoRegister,
PPC::CR0, PPC::CR0GT,
PPC::NoRegister, PPC::NoRegister,
PPC::CR5, PPC::CR5UN,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X26, PPC::R26,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR3, PPC::CR3EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X14, PPC::R14,
PPC::CR0, PPC::CR0LT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X27, PPC::R27,
PPC::NoRegister, PPC::NoRegister,
PPC::CR3, PPC::CR3GT,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR0, PPC::CR0UN,
PPC::NoRegister, PPC::NoRegister,
PPC::X15, PPC::R15,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::CR6, PPC::CR6EQ,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
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PPC::X28, PPC::R28,
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const unsigned SubregHashTableSize = 512;
// Number of hash collisions: 10
const unsigned SuperregHashTable[] = { PPC::NoRegister, PPC::NoRegister,
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// Number of hash collisions: 11
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PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::NoRegister, PPC::NoRegister,
PPC::X1, PPC::R1,
PPC::NoRegister, PPC::NoRegister,
PPC::X6, PPC::R6,
PPC::NoRegister, PPC::NoRegister };
const unsigned AliasesHashTableSize = 1024;
// Register Alias Sets...
const unsigned Empty_AliasSet[] = { 0 };
const unsigned CARRY_AliasSet[] = { 0 };
const unsigned CR0_AliasSet[] = { PPC::CR0LT, PPC::CR0GT, PPC::CR0EQ, PPC::CR0UN, 0 };
const unsigned CR0EQ_AliasSet[] = { PPC::CR0, 0 };
const unsigned CR0GT_AliasSet[] = { PPC::CR0, 0 };
const unsigned CR0LT_AliasSet[] = { PPC::CR0, 0 };
const unsigned CR0UN_AliasSet[] = { PPC::CR0, 0 };
const unsigned CR1_AliasSet[] = { PPC::CR1LT, PPC::CR1GT, PPC::CR1EQ, PPC::CR1UN, 0 };
const unsigned CR1EQ_AliasSet[] = { PPC::CR1, 0 };
const unsigned CR1GT_AliasSet[] = { PPC::CR1, 0 };
const unsigned CR1LT_AliasSet[] = { PPC::CR1, 0 };
const unsigned CR1UN_AliasSet[] = { PPC::CR1, 0 };
const unsigned CR2_AliasSet[] = { PPC::CR2LT, PPC::CR2GT, PPC::CR2EQ, PPC::CR2UN, 0 };
const unsigned CR2EQ_AliasSet[] = { PPC::CR2, 0 };
const unsigned CR2GT_AliasSet[] = { PPC::CR2, 0 };
const unsigned CR2LT_AliasSet[] = { PPC::CR2, 0 };
const unsigned CR2UN_AliasSet[] = { PPC::CR2, 0 };
const unsigned CR3_AliasSet[] = { PPC::CR3LT, PPC::CR3GT, PPC::CR3EQ, PPC::CR3UN, 0 };
const unsigned CR3EQ_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR3GT_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR3LT_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR3UN_AliasSet[] = { PPC::CR3, 0 };
const unsigned CR4_AliasSet[] = { PPC::CR4LT, PPC::CR4GT, PPC::CR4EQ, PPC::CR4UN, 0 };
const unsigned CR4EQ_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4GT_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4LT_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR4UN_AliasSet[] = { PPC::CR4, 0 };
const unsigned CR5_AliasSet[] = { PPC::CR5LT, PPC::CR5GT, PPC::CR5EQ, PPC::CR5UN, 0 };
const unsigned CR5EQ_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5GT_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5LT_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR5UN_AliasSet[] = { PPC::CR5, 0 };
const unsigned CR6_AliasSet[] = { PPC::CR6LT, PPC::CR6GT, PPC::CR6EQ, PPC::CR6UN, 0 };
const unsigned CR6EQ_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6GT_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6LT_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR6UN_AliasSet[] = { PPC::CR6, 0 };
const unsigned CR7_AliasSet[] = { PPC::CR7LT, PPC::CR7GT, PPC::CR7EQ, PPC::CR7UN, 0 };
const unsigned CR7EQ_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7GT_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7LT_AliasSet[] = { PPC::CR7, 0 };
const unsigned CR7UN_AliasSet[] = { PPC::CR7, 0 };
const unsigned CTR_AliasSet[] = { 0 };
const unsigned CTR8_AliasSet[] = { 0 };
const unsigned F0_AliasSet[] = { 0 };
const unsigned F1_AliasSet[] = { 0 };
const unsigned F10_AliasSet[] = { 0 };
const unsigned F11_AliasSet[] = { 0 };
const unsigned F12_AliasSet[] = { 0 };
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const unsigned F6_AliasSet[] = { 0 };
const unsigned F7_AliasSet[] = { 0 };
const unsigned F8_AliasSet[] = { 0 };
const unsigned F9_AliasSet[] = { 0 };
const unsigned LR_AliasSet[] = { 0 };
const unsigned LR8_AliasSet[] = { 0 };
const unsigned R0_AliasSet[] = { PPC::X0, 0 };
const unsigned R1_AliasSet[] = { PPC::X1, 0 };
const unsigned R10_AliasSet[] = { PPC::X10, 0 };
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const unsigned R15_AliasSet[] = { PPC::X15, 0 };
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const unsigned R7_AliasSet[] = { PPC::X7, 0 };
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const unsigned R9_AliasSet[] = { PPC::X9, 0 };
const unsigned RM_AliasSet[] = { 0 };
const unsigned V0_AliasSet[] = { 0 };
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{ "CR3", CR3_AliasSet, CR3_SubRegsSet, CR3_SuperRegsSet },
{ "CR3EQ", CR3EQ_AliasSet, CR3EQ_SubRegsSet, CR3EQ_SuperRegsSet },
{ "CR3GT", CR3GT_AliasSet, CR3GT_SubRegsSet, CR3GT_SuperRegsSet },
{ "CR3LT", CR3LT_AliasSet, CR3LT_SubRegsSet, CR3LT_SuperRegsSet },
{ "CR3UN", CR3UN_AliasSet, CR3UN_SubRegsSet, CR3UN_SuperRegsSet },
{ "CR4", CR4_AliasSet, CR4_SubRegsSet, CR4_SuperRegsSet },
{ "CR4EQ", CR4EQ_AliasSet, CR4EQ_SubRegsSet, CR4EQ_SuperRegsSet },
{ "CR4GT", CR4GT_AliasSet, CR4GT_SubRegsSet, CR4GT_SuperRegsSet },
{ "CR4LT", CR4LT_AliasSet, CR4LT_SubRegsSet, CR4LT_SuperRegsSet },
{ "CR4UN", CR4UN_AliasSet, CR4UN_SubRegsSet, CR4UN_SuperRegsSet },
{ "CR5", CR5_AliasSet, CR5_SubRegsSet, CR5_SuperRegsSet },
{ "CR5EQ", CR5EQ_AliasSet, CR5EQ_SubRegsSet, CR5EQ_SuperRegsSet },
{ "CR5GT", CR5GT_AliasSet, CR5GT_SubRegsSet, CR5GT_SuperRegsSet },
{ "CR5LT", CR5LT_AliasSet, CR5LT_SubRegsSet, CR5LT_SuperRegsSet },
{ "CR5UN", CR5UN_AliasSet, CR5UN_SubRegsSet, CR5UN_SuperRegsSet },
{ "CR6", CR6_AliasSet, CR6_SubRegsSet, CR6_SuperRegsSet },
{ "CR6EQ", CR6EQ_AliasSet, CR6EQ_SubRegsSet, CR6EQ_SuperRegsSet },
{ "CR6GT", CR6GT_AliasSet, CR6GT_SubRegsSet, CR6GT_SuperRegsSet },
{ "CR6LT", CR6LT_AliasSet, CR6LT_SubRegsSet, CR6LT_SuperRegsSet },
{ "CR6UN", CR6UN_AliasSet, CR6UN_SubRegsSet, CR6UN_SuperRegsSet },
{ "CR7", CR7_AliasSet, CR7_SubRegsSet, CR7_SuperRegsSet },
{ "CR7EQ", CR7EQ_AliasSet, CR7EQ_SubRegsSet, CR7EQ_SuperRegsSet },
{ "CR7GT", CR7GT_AliasSet, CR7GT_SubRegsSet, CR7GT_SuperRegsSet },
{ "CR7LT", CR7LT_AliasSet, CR7LT_SubRegsSet, CR7LT_SuperRegsSet },
{ "CR7UN", CR7UN_AliasSet, CR7UN_SubRegsSet, CR7UN_SuperRegsSet },
{ "CTR", CTR_AliasSet, CTR_SubRegsSet, CTR_SuperRegsSet },
{ "CTR8", CTR8_AliasSet, CTR8_SubRegsSet, CTR8_SuperRegsSet },
{ "F0", F0_AliasSet, F0_SubRegsSet, F0_SuperRegsSet },
{ "F1", F1_AliasSet, F1_SubRegsSet, F1_SuperRegsSet },
{ "F10", F10_AliasSet, F10_SubRegsSet, F10_SuperRegsSet },
{ "F11", F11_AliasSet, F11_SubRegsSet, F11_SuperRegsSet },
{ "F12", F12_AliasSet, F12_SubRegsSet, F12_SuperRegsSet },
{ "F13", F13_AliasSet, F13_SubRegsSet, F13_SuperRegsSet },
{ "F14", F14_AliasSet, F14_SubRegsSet, F14_SuperRegsSet },
{ "F15", F15_AliasSet, F15_SubRegsSet, F15_SuperRegsSet },
{ "F16", F16_AliasSet, F16_SubRegsSet, F16_SuperRegsSet },
{ "F17", F17_AliasSet, F17_SubRegsSet, F17_SuperRegsSet },
{ "F18", F18_AliasSet, F18_SubRegsSet, F18_SuperRegsSet },
{ "F19", F19_AliasSet, F19_SubRegsSet, F19_SuperRegsSet },
{ "F2", F2_AliasSet, F2_SubRegsSet, F2_SuperRegsSet },
{ "F20", F20_AliasSet, F20_SubRegsSet, F20_SuperRegsSet },
{ "F21", F21_AliasSet, F21_SubRegsSet, F21_SuperRegsSet },
{ "F22", F22_AliasSet, F22_SubRegsSet, F22_SuperRegsSet },
{ "F23", F23_AliasSet, F23_SubRegsSet, F23_SuperRegsSet },
{ "F24", F24_AliasSet, F24_SubRegsSet, F24_SuperRegsSet },
{ "F25", F25_AliasSet, F25_SubRegsSet, F25_SuperRegsSet },
{ "F26", F26_AliasSet, F26_SubRegsSet, F26_SuperRegsSet },
{ "F27", F27_AliasSet, F27_SubRegsSet, F27_SuperRegsSet },
{ "F28", F28_AliasSet, F28_SubRegsSet, F28_SuperRegsSet },
{ "F29", F29_AliasSet, F29_SubRegsSet, F29_SuperRegsSet },
{ "F3", F3_AliasSet, F3_SubRegsSet, F3_SuperRegsSet },
{ "F30", F30_AliasSet, F30_SubRegsSet, F30_SuperRegsSet },
{ "F31", F31_AliasSet, F31_SubRegsSet, F31_SuperRegsSet },
{ "F4", F4_AliasSet, F4_SubRegsSet, F4_SuperRegsSet },
{ "F5", F5_AliasSet, F5_SubRegsSet, F5_SuperRegsSet },
{ "F6", F6_AliasSet, F6_SubRegsSet, F6_SuperRegsSet },
{ "F7", F7_AliasSet, F7_SubRegsSet, F7_SuperRegsSet },
{ "F8", F8_AliasSet, F8_SubRegsSet, F8_SuperRegsSet },
{ "F9", F9_AliasSet, F9_SubRegsSet, F9_SuperRegsSet },
{ "LR", LR_AliasSet, LR_SubRegsSet, LR_SuperRegsSet },
{ "LR8", LR8_AliasSet, LR8_SubRegsSet, LR8_SuperRegsSet },
{ "R0", R0_AliasSet, R0_SubRegsSet, R0_SuperRegsSet },
{ "R1", R1_AliasSet, R1_SubRegsSet, R1_SuperRegsSet },
{ "R10", R10_AliasSet, R10_SubRegsSet, R10_SuperRegsSet },
{ "R11", R11_AliasSet, R11_SubRegsSet, R11_SuperRegsSet },
{ "R12", R12_AliasSet, R12_SubRegsSet, R12_SuperRegsSet },
{ "R13", R13_AliasSet, R13_SubRegsSet, R13_SuperRegsSet },
{ "R14", R14_AliasSet, R14_SubRegsSet, R14_SuperRegsSet },
{ "R15", R15_AliasSet, R15_SubRegsSet, R15_SuperRegsSet },
{ "R16", R16_AliasSet, R16_SubRegsSet, R16_SuperRegsSet },
{ "R17", R17_AliasSet, R17_SubRegsSet, R17_SuperRegsSet },
{ "R18", R18_AliasSet, R18_SubRegsSet, R18_SuperRegsSet },
{ "R19", R19_AliasSet, R19_SubRegsSet, R19_SuperRegsSet },
{ "R2", R2_AliasSet, R2_SubRegsSet, R2_SuperRegsSet },
{ "R20", R20_AliasSet, R20_SubRegsSet, R20_SuperRegsSet },
{ "R21", R21_AliasSet, R21_SubRegsSet, R21_SuperRegsSet },
{ "R22", R22_AliasSet, R22_SubRegsSet, R22_SuperRegsSet },
{ "R23", R23_AliasSet, R23_SubRegsSet, R23_SuperRegsSet },
{ "R24", R24_AliasSet, R24_SubRegsSet, R24_SuperRegsSet },
{ "R25", R25_AliasSet, R25_SubRegsSet, R25_SuperRegsSet },
{ "R26", R26_AliasSet, R26_SubRegsSet, R26_SuperRegsSet },
{ "R27", R27_AliasSet, R27_SubRegsSet, R27_SuperRegsSet },
{ "R28", R28_AliasSet, R28_SubRegsSet, R28_SuperRegsSet },
{ "R29", R29_AliasSet, R29_SubRegsSet, R29_SuperRegsSet },
{ "R3", R3_AliasSet, R3_SubRegsSet, R3_SuperRegsSet },
{ "R30", R30_AliasSet, R30_SubRegsSet, R30_SuperRegsSet },
{ "R31", R31_AliasSet, R31_SubRegsSet, R31_SuperRegsSet },
{ "R4", R4_AliasSet, R4_SubRegsSet, R4_SuperRegsSet },
{ "R5", R5_AliasSet, R5_SubRegsSet, R5_SuperRegsSet },
{ "R6", R6_AliasSet, R6_SubRegsSet, R6_SuperRegsSet },
{ "R7", R7_AliasSet, R7_SubRegsSet, R7_SuperRegsSet },
{ "R8", R8_AliasSet, R8_SubRegsSet, R8_SuperRegsSet },
{ "R9", R9_AliasSet, R9_SubRegsSet, R9_SuperRegsSet },
{ "RM", RM_AliasSet, RM_SubRegsSet, RM_SuperRegsSet },
{ "V0", V0_AliasSet, V0_SubRegsSet, V0_SuperRegsSet },
{ "V1", V1_AliasSet, V1_SubRegsSet, V1_SuperRegsSet },
{ "V10", V10_AliasSet, V10_SubRegsSet, V10_SuperRegsSet },
{ "V11", V11_AliasSet, V11_SubRegsSet, V11_SuperRegsSet },
{ "V12", V12_AliasSet, V12_SubRegsSet, V12_SuperRegsSet },
{ "V13", V13_AliasSet, V13_SubRegsSet, V13_SuperRegsSet },
{ "V14", V14_AliasSet, V14_SubRegsSet, V14_SuperRegsSet },
{ "V15", V15_AliasSet, V15_SubRegsSet, V15_SuperRegsSet },
{ "V16", V16_AliasSet, V16_SubRegsSet, V16_SuperRegsSet },
{ "V17", V17_AliasSet, V17_SubRegsSet, V17_SuperRegsSet },
{ "V18", V18_AliasSet, V18_SubRegsSet, V18_SuperRegsSet },
{ "V19", V19_AliasSet, V19_SubRegsSet, V19_SuperRegsSet },
{ "V2", V2_AliasSet, V2_SubRegsSet, V2_SuperRegsSet },
{ "V20", V20_AliasSet, V20_SubRegsSet, V20_SuperRegsSet },
{ "V21", V21_AliasSet, V21_SubRegsSet, V21_SuperRegsSet },
{ "V22", V22_AliasSet, V22_SubRegsSet, V22_SuperRegsSet },
{ "V23", V23_AliasSet, V23_SubRegsSet, V23_SuperRegsSet },
{ "V24", V24_AliasSet, V24_SubRegsSet, V24_SuperRegsSet },
{ "V25", V25_AliasSet, V25_SubRegsSet, V25_SuperRegsSet },
{ "V26", V26_AliasSet, V26_SubRegsSet, V26_SuperRegsSet },
{ "V27", V27_AliasSet, V27_SubRegsSet, V27_SuperRegsSet },
{ "V28", V28_AliasSet, V28_SubRegsSet, V28_SuperRegsSet },
{ "V29", V29_AliasSet, V29_SubRegsSet, V29_SuperRegsSet },
{ "V3", V3_AliasSet, V3_SubRegsSet, V3_SuperRegsSet },
{ "V30", V30_AliasSet, V30_SubRegsSet, V30_SuperRegsSet },
{ "V31", V31_AliasSet, V31_SubRegsSet, V31_SuperRegsSet },
{ "V4", V4_AliasSet, V4_SubRegsSet, V4_SuperRegsSet },
{ "V5", V5_AliasSet, V5_SubRegsSet, V5_SuperRegsSet },
{ "V6", V6_AliasSet, V6_SubRegsSet, V6_SuperRegsSet },
{ "V7", V7_AliasSet, V7_SubRegsSet, V7_SuperRegsSet },
{ "V8", V8_AliasSet, V8_SubRegsSet, V8_SuperRegsSet },
{ "V9", V9_AliasSet, V9_SubRegsSet, V9_SuperRegsSet },
{ "VRSAVE", VRSAVE_AliasSet, VRSAVE_SubRegsSet, VRSAVE_SuperRegsSet },
{ "X0", X0_AliasSet, X0_SubRegsSet, X0_SuperRegsSet },
{ "X1", X1_AliasSet, X1_SubRegsSet, X1_SuperRegsSet },
{ "X10", X10_AliasSet, X10_SubRegsSet, X10_SuperRegsSet },
{ "X11", X11_AliasSet, X11_SubRegsSet, X11_SuperRegsSet },
{ "X12", X12_AliasSet, X12_SubRegsSet, X12_SuperRegsSet },
{ "X13", X13_AliasSet, X13_SubRegsSet, X13_SuperRegsSet },
{ "X14", X14_AliasSet, X14_SubRegsSet, X14_SuperRegsSet },
{ "X15", X15_AliasSet, X15_SubRegsSet, X15_SuperRegsSet },
{ "X16", X16_AliasSet, X16_SubRegsSet, X16_SuperRegsSet },
{ "X17", X17_AliasSet, X17_SubRegsSet, X17_SuperRegsSet },
{ "X18", X18_AliasSet, X18_SubRegsSet, X18_SuperRegsSet },
{ "X19", X19_AliasSet, X19_SubRegsSet, X19_SuperRegsSet },
{ "X2", X2_AliasSet, X2_SubRegsSet, X2_SuperRegsSet },
{ "X20", X20_AliasSet, X20_SubRegsSet, X20_SuperRegsSet },
{ "X21", X21_AliasSet, X21_SubRegsSet, X21_SuperRegsSet },
{ "X22", X22_AliasSet, X22_SubRegsSet, X22_SuperRegsSet },
{ "X23", X23_AliasSet, X23_SubRegsSet, X23_SuperRegsSet },
{ "X24", X24_AliasSet, X24_SubRegsSet, X24_SuperRegsSet },
{ "X25", X25_AliasSet, X25_SubRegsSet, X25_SuperRegsSet },
{ "X26", X26_AliasSet, X26_SubRegsSet, X26_SuperRegsSet },
{ "X27", X27_AliasSet, X27_SubRegsSet, X27_SuperRegsSet },
{ "X28", X28_AliasSet, X28_SubRegsSet, X28_SuperRegsSet },
{ "X29", X29_AliasSet, X29_SubRegsSet, X29_SuperRegsSet },
{ "X3", X3_AliasSet, X3_SubRegsSet, X3_SuperRegsSet },
{ "X30", X30_AliasSet, X30_SubRegsSet, X30_SuperRegsSet },
{ "X31", X31_AliasSet, X31_SubRegsSet, X31_SuperRegsSet },
{ "X4", X4_AliasSet, X4_SubRegsSet, X4_SuperRegsSet },
{ "X5", X5_AliasSet, X5_SubRegsSet, X5_SuperRegsSet },
{ "X6", X6_AliasSet, X6_SubRegsSet, X6_SuperRegsSet },
{ "X7", X7_AliasSet, X7_SubRegsSet, X7_SuperRegsSet },
{ "X8", X8_AliasSet, X8_SubRegsSet, X8_SuperRegsSet },
{ "X9", X9_AliasSet, X9_SubRegsSet, X9_SuperRegsSet },
};
}
unsigned PPCGenRegisterInfo::getSubReg(unsigned RegNo, unsigned Index) const {
switch (RegNo) {
default:
return 0;
case PPC::CR0:
switch (Index) {
default: return 0;
case 1: return PPC::CR0LT;
case 2: return PPC::CR0GT;
case 3: return PPC::CR0EQ;
case 4: return PPC::CR0UN;
};
break;
case PPC::CR1:
switch (Index) {
default: return 0;
case 1: return PPC::CR1LT;
case 2: return PPC::CR1GT;
case 3: return PPC::CR1EQ;
case 4: return PPC::CR1UN;
};
break;
case PPC::CR2:
switch (Index) {
default: return 0;
case 1: return PPC::CR2LT;
case 2: return PPC::CR2GT;
case 3: return PPC::CR2EQ;
case 4: return PPC::CR2UN;
};
break;
case PPC::CR3:
switch (Index) {
default: return 0;
case 1: return PPC::CR3LT;
case 2: return PPC::CR3GT;
case 3: return PPC::CR3EQ;
case 4: return PPC::CR3UN;
};
break;
case PPC::CR4:
switch (Index) {
default: return 0;
case 1: return PPC::CR4LT;
case 2: return PPC::CR4GT;
case 3: return PPC::CR4EQ;
case 4: return PPC::CR4UN;
};
break;
case PPC::CR5:
switch (Index) {
default: return 0;
case 1: return PPC::CR5LT;
case 2: return PPC::CR5GT;
case 3: return PPC::CR5EQ;
case 4: return PPC::CR5UN;
};
break;
case PPC::CR6:
switch (Index) {
default: return 0;
case 1: return PPC::CR6LT;
case 2: return PPC::CR6GT;
case 3: return PPC::CR6EQ;
case 4: return PPC::CR6UN;
};
break;
case PPC::CR7:
switch (Index) {
default: return 0;
case 1: return PPC::CR7LT;
case 2: return PPC::CR7GT;
case 3: return PPC::CR7EQ;
case 4: return PPC::CR7UN;
};
break;
};
return 0;
}
unsigned PPCGenRegisterInfo::getSubRegIndex(unsigned RegNo, unsigned SubRegNo) const {
switch (RegNo) {
default:
return 0;
case PPC::CR0:
if (SubRegNo == PPC::CR0LT) return 1;
if (SubRegNo == PPC::CR0GT) return 2;
if (SubRegNo == PPC::CR0EQ) return 3;
if (SubRegNo == PPC::CR0UN) return 4;
return 0;
case PPC::CR1:
if (SubRegNo == PPC::CR1LT) return 1;
if (SubRegNo == PPC::CR1GT) return 2;
if (SubRegNo == PPC::CR1EQ) return 3;
if (SubRegNo == PPC::CR1UN) return 4;
return 0;
case PPC::CR2:
if (SubRegNo == PPC::CR2LT) return 1;
if (SubRegNo == PPC::CR2GT) return 2;
if (SubRegNo == PPC::CR2EQ) return 3;
if (SubRegNo == PPC::CR2UN) return 4;
return 0;
case PPC::CR3:
if (SubRegNo == PPC::CR3LT) return 1;
if (SubRegNo == PPC::CR3GT) return 2;
if (SubRegNo == PPC::CR3EQ) return 3;
if (SubRegNo == PPC::CR3UN) return 4;
return 0;
case PPC::CR4:
if (SubRegNo == PPC::CR4LT) return 1;
if (SubRegNo == PPC::CR4GT) return 2;
if (SubRegNo == PPC::CR4EQ) return 3;
if (SubRegNo == PPC::CR4UN) return 4;
return 0;
case PPC::CR5:
if (SubRegNo == PPC::CR5LT) return 1;
if (SubRegNo == PPC::CR5GT) return 2;
if (SubRegNo == PPC::CR5EQ) return 3;
if (SubRegNo == PPC::CR5UN) return 4;
return 0;
case PPC::CR6:
if (SubRegNo == PPC::CR6LT) return 1;
if (SubRegNo == PPC::CR6GT) return 2;
if (SubRegNo == PPC::CR6EQ) return 3;
if (SubRegNo == PPC::CR6UN) return 4;
return 0;
case PPC::CR7:
if (SubRegNo == PPC::CR7LT) return 1;
if (SubRegNo == PPC::CR7GT) return 2;
if (SubRegNo == PPC::CR7EQ) return 3;
if (SubRegNo == PPC::CR7UN) return 4;
return 0;
};
return 0;
}
PPCGenRegisterInfo::PPCGenRegisterInfo(int CallFrameSetupOpcode, int CallFrameDestroyOpcode)
: TargetRegisterInfo(RegisterDescriptors, 176, RegisterClasses, RegisterClasses+11,
CallFrameSetupOpcode, CallFrameDestroyOpcode,
SubregHashTable, SubregHashTableSize,
SuperregHashTable, SuperregHashTableSize,
AliasesHashTable, AliasesHashTableSize) {
}
int PPCGenRegisterInfo::getDwarfRegNumFull(unsigned RegNum, unsigned Flavour) const {
switch (Flavour) {
default:
assert(0 && "Unknown DWARF flavour");
return -1;
case 0:
switch (RegNum) {
default:
assert(0 && "Invalid RegNum");
return -1;
case PPC::CARRY:
return 0;
case PPC::CR0:
return 68;
case PPC::CR0EQ:
return 0;
case PPC::CR0GT:
return 0;
case PPC::CR0LT:
return 0;
case PPC::CR0UN:
return 0;
case PPC::CR1:
return 69;
case PPC::CR1EQ:
return 0;
case PPC::CR1GT:
return 0;
case PPC::CR1LT:
return 0;
case PPC::CR1UN:
return 0;
case PPC::CR2:
return 70;
case PPC::CR2EQ:
return 0;
case PPC::CR2GT:
return 0;
case PPC::CR2LT:
return 0;
case PPC::CR2UN:
return 0;
case PPC::CR3:
return 71;
case PPC::CR3EQ:
return 0;
case PPC::CR3GT:
return 0;
case PPC::CR3LT:
return 0;
case PPC::CR3UN:
return 0;
case PPC::CR4:
return 72;
case PPC::CR4EQ:
return 0;
case PPC::CR4GT:
return 0;
case PPC::CR4LT:
return 0;
case PPC::CR4UN:
return 0;
case PPC::CR5:
return 73;
case PPC::CR5EQ:
return 0;
case PPC::CR5GT:
return 0;
case PPC::CR5LT:
return 0;
case PPC::CR5UN:
return 0;
case PPC::CR6:
return 74;
case PPC::CR6EQ:
return 0;
case PPC::CR6GT:
return 0;
case PPC::CR6LT:
return 0;
case PPC::CR6UN:
return 0;
case PPC::CR7:
return 75;
case PPC::CR7EQ:
return 0;
case PPC::CR7GT:
return 0;
case PPC::CR7LT:
return 0;
case PPC::CR7UN:
return 0;
case PPC::CTR:
return 66;
case PPC::CTR8:
return 66;
case PPC::F0:
return 32;
case PPC::F1:
return 33;
case PPC::F10:
return 42;
case PPC::F11:
return 43;
case PPC::F12:
return 44;
case PPC::F13:
return 45;
case PPC::F14:
return 46;
case PPC::F15:
return 47;
case PPC::F16:
return 48;
case PPC::F17:
return 49;
case PPC::F18:
return 50;
case PPC::F19:
return 51;
case PPC::F2:
return 34;
case PPC::F20:
return 52;
case PPC::F21:
return 53;
case PPC::F22:
return 54;
case PPC::F23:
return 55;
case PPC::F24:
return 56;
case PPC::F25:
return 57;
case PPC::F26:
return 58;
case PPC::F27:
return 59;
case PPC::F28:
return 60;
case PPC::F29:
return 61;
case PPC::F3:
return 35;
case PPC::F30:
return 62;
case PPC::F31:
return 63;
case PPC::F4:
return 36;
case PPC::F5:
return 37;
case PPC::F6:
return 38;
case PPC::F7:
return 39;
case PPC::F8:
return 40;
case PPC::F9:
return 41;
case PPC::LR:
return 65;
case PPC::LR8:
return 65;
case PPC::R0:
return 0;
case PPC::R1:
return 1;
case PPC::R10:
return 10;
case PPC::R11:
return 11;
case PPC::R12:
return 12;
case PPC::R13:
return 13;
case PPC::R14:
return 14;
case PPC::R15:
return 15;
case PPC::R16:
return 16;
case PPC::R17:
return 17;
case PPC::R18:
return 18;
case PPC::R19:
return 19;
case PPC::R2:
return 2;
case PPC::R20:
return 20;
case PPC::R21:
return 21;
case PPC::R22:
return 22;
case PPC::R23:
return 23;
case PPC::R24:
return 24;
case PPC::R25:
return 25;
case PPC::R26:
return 26;
case PPC::R27:
return 27;
case PPC::R28:
return 28;
case PPC::R29:
return 29;
case PPC::R3:
return 3;
case PPC::R30:
return 30;
case PPC::R31:
return 31;
case PPC::R4:
return 4;
case PPC::R5:
return 5;
case PPC::R6:
return 6;
case PPC::R7:
return 7;
case PPC::R8:
return 8;
case PPC::R9:
return 9;
case PPC::RM:
return 0;
case PPC::V0:
return 77;
case PPC::V1:
return 78;
case PPC::V10:
return 87;
case PPC::V11:
return 88;
case PPC::V12:
return 89;
case PPC::V13:
return 90;
case PPC::V14:
return 91;
case PPC::V15:
return 92;
case PPC::V16:
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